기술 인식 비용 함수를 사용한 E-그래프 리라이팅을 통한 논리 합성
Conceptos Básicos
E-Syn은 E-그래프를 활용하여 논리 회로의 다양한 등가 표현을 효율적으로 탐색하고, 기술 의존적 비용 모델을 통해 지연 및 면적 최적화를 수행한다.
Resumen
E-Syn은 기존 논리 합성 흐름에 E-그래프 기반 최적화 단계를 추가한다. E-그래프는 등가 관계를 효율적으로 표현하여 다양한 등가 논리 형태를 유지할 수 있다. E-Syn은 리라이팅 단계에서 이러한 등가 형태들을 탐색하고, 추출 단계에서 기술 의존적 비용 모델을 활용하여 최적의 논리 형태를 선택한다.
주요 내용은 다음과 같다:
- E-그래프를 활용한 논리 리라이팅: 부울 대수 규칙을 기반으로 등가 논리 형태를 생성한다.
- 기술 인식 비용 모델: XGBoost 회귀 모델을 사용하여 지연 및 면적 비용을 예측하고, 이를 추출 단계에서 활용한다.
- 효율적인 추출 방법: 후보 풀 추출 방법을 제안하여 비선형 비용 함수를 효과적으로 처리한다.
- 실험 결과: E-Syn은 기존 AIG 기반 최적화 대비 지연 15.29% 감소, 면적 6.42% 감소를 달성한다.
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E-Syn
Estadísticas
지연 최적화 시 E-Syn은 기존 AIG 기반 최적화 대비 평균 15.29% 지연 감소를 달성했다.
면적 최적화 시 E-Syn은 기존 AIG 기반 최적화 대비 평균 6.42% 면적 감소를 달성했다.
Citas
"E-Syn은 기존 AIG 기반 최적화 대비 지연 15.29% 감소, 면적 6.42% 감소를 달성했다."
"E-Syn은 기술 의존적 비용 모델을 활용하여 최적의 논리 형태를 선택한다."
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